프로세서 제조업체는 기본 및 응용 연구 개발을 멈추지 않으므로 이제 Taiwan Semiconductor Manufacturing Co. (TSMC)는 2년에 N2(2025nm급) 제조 공정의 다중 볼륨 제조(HVM)에 들어가는 일정을 설정했으며, 이제 회사가 다음 공정에 대해 생각할 때입니다. 새로운 소문이 믿어지면 TSMC는 1,4월에 nm급 기술을 공식 발표할 예정입니다.
이에 TSMC는 오는 3월 N3노드(1,4나노급) 개발팀을 1,4나노급 제조공정 개발팀으로 이관할 계획이다. 일반적으로 파운드리 및 칩 제조업체는 이정표를 공식적으로 발표하지 않으므로 TSMC에서 2nm 칩 개발이 시작되었다는 보도 자료를 볼 가능성은 낮습니다. 한편, TSMC는 월 중순에 기술 심포지엄을 개최할 예정이며, 그곳에서 회사는 N 제조 공정을 대체할 노드에 대한 간략한 세부 정보를 공개할 수 있습니다.
표준 기술 설계 프로세스에는 방법 찾기, 연구 및 개발 단계가 포함됩니다. 길 찾기에는 재료 및 물리학에 대한 기초 연구와 같은 것들이 포함되며 많은 경우 많은 칩에서 동시에 수행됩니다. 현재 TSMC의 2nm 경로 찾기는 아마도 끝났기 때문에 기본 물리 및 화학을 전문으로 하는 관련 그룹이 2nm 또는 1,4옹스트롬이라고 할 수 있는 14nm의 후속 제품을 연구하고 있습니다.
TSMC의 2nm는 게이트 게이트 전계 효과 트랜지스터(GAAFET)를 기반으로 하지만 개구수가 0,33(0,33 NA)인 기존 극자외선(EUV) 리소그래피를 사용합니다. 오늘날 우리가 알고 있는 TSMC의 2nm 세부 사항을 감안할 때 후속 제품이 GAA 트랜지스터를 유지할 가능성이 있지만 개구수가 0,55인 EUV 도구로 전환할지 여부는 여전히 두고 봐야 합니다.
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